Ht353sd Sm Dvd Lg
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RECEPTOR DVD/CDMANUAL DE SERVICIO
MODELO: HT353SD (HT353SD-A2, SH33SD-S/W)
Pgina Web http://biz.lgservice.comSlo para uso interno
P/NO : AFN37064428 AUGUST, 2008
MO
DELO:
HT
353SD
(HT
353SD
-A2, S
H33S
D-S
/W)
MA
NUAL D
E SERVICIO
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1-1Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
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[CONTENIDO] SECCIN 1. GENERAL
MEDIDAS DE PRECAUCIN DURANTE LAS TAREAS DE CUIDADO Y MANTENIMIENTO . . . . . . . . . 1-2 MEDIDAS DE PRECAUCIN ESD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-4 INFORMACIN DE SERVICIO PARA EEPROM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-5 CMO ACTUALIZAR LOS PROGRAMAS MICOM AUDIO Y DVD . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-7 ESPECIFICACIONES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-8
SECCIN 2. PARTE ELECTRICA GUA DE SOLUCIN DE AVERAS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-1 DETALLES Y FORMAS DE ONDA EN LAS PRUEBAS Y ELIMINACIN
DE ERRORES DEL SISTEMA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .2-13 DIAGRAMA DE BLOQUE INTERNO DE CIs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .2-25 DIAGRAMA DEL CABLEADO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-45 DIAGRAMA DE BLOQUE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-47 DIAGRAMAS DE CIRCUITO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-49 DIAGRAMAS DE PLACA DE CIRCUITO IMPRESO . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-69
SECCIN 3. VISTAS AMPLIADAS SECCIN DEL ARMARIO Y ESTRUCTURA PRINCIPAL . . . . . . . . . . . . . . . . . . . . . . . . . 3-1 VISTA AMPLIADA DEL MECANISMO DE LA PLETINA(DP-12TV) . . . . . . . . . . . . . . . . . . 3-3 SECCIN DE ACCESORIOS DE EMBALAJE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-5 PARTE DE ALTAVOCES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-6
SECCIN 4. MECANISMO (DP-12TV) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1 SECCIN 5. LISTA DE PIEZAS DE REPUESTO . . . . . . . . . . . . . . . . . . . . . . . . . . . 5-1
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MEDIDAS DE PRECAUCIN DURANTE LAS TAREAS DE CUIDADO Y MANTENIMIENTONOTAS RELACIONADAS CON LA MANIPULACIN DEL LECTOR1. Notas de transporte y almacenamiento
1) El lector deber permanecer en su bolsa conductora hasta el momento inmediatamente previo al uso.2) El lector no debe ser expuesto a presiones externas o golpes.
2. Notas de reparacin1) El lector incluye un imn de gran tamao, y no debe acercarse nunca a materiales magnticos.2) El lector debe ser manipulado correctamente y con cuidado, teniendo cuidado de evitar
presiones externas y golpes. Si as fuera, el resultado podra ser una avera operativa o daosen la placa de circuito impreso.
3) Cada uno de los captadores ha sido ya ajustado individualmente a un alto nivel de precisin,motivo por el que el punto de ajuste y los tornillos de instalacin no deben tocarse nunca.
4) El haz del lser puede daar los ojos!No mire nunca directamente al haz del lser! Igualmente, no encienda NUNCAla alimentacin de la pieza de salida lser (lente, etc.) del lector si estuviera daado.
5) Limpieza de la superficie de la lenteSi hubiera polvo en la superficie de la lente, lmpielo mediante un pulverizador (como losempleados para limpiar las lentes de las cmaras). La lente est sujeta por un delicado soporte.Por lo tanto, al limpiar la superficie de la lente, utilice un bastoncillo de algodn con cuidado de
6) Nunca intente desmontar el resorte del lector ejerciendo una presin excesiva. Si la lenteestuviera extremadamente sucia, aplique alcohol isoproplico al bastoncillo de algodn. (Noutilice ningn otro limpiador lquido, ya que podra daar la lente.) Tenga cuidado de no aplicardemasiado alcohol en el bastoncillo, y no permita que el lquido entre en el interior del lector.
Almacenamiento en bolsa conductora Impacto por cada
No mire NUNCA directamente al haz del lser, y no lo toque conlos dedos u otras partes expuestas de su cuerpo.
Imn
Cmo sujetar el lector
Bastoncillo de algodn
Lminaconductora
Presin
Presin
SECCIN 1. GENERAL
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NOTAS RELACIONADAS CON LA REPARACIN DE REPRODUCTORES DE CD1. Preparacin
1) Los reproductores de CD incorporan un gran nmero de CIs, as como un lector (diodo lser).Estos componentes son muy sensibles y se ven fcilmente afectados por la electricidad esttica. En elcaso de electricidad esttica de alta tensin los componentes podran resultar daados, motivo por elque deben manipularse con cuidado.
2) El lector est compuesto de numerosos componentes pticos y otros de gran precisin.Por lo tanto, tenga cuidado de evitar realizar labores de reparacin o almacenamiento cuando latemperatura o humedad son altas, en presencia de fuerte magnetismo o grandes cantidades de polvo.
2. Notas de reparacin1) Antes de reemplazar una pieza o componente, desconecte primero el cable de alimentacin de la
unidad.2) Todo el equipamiento, instrumentos de medicin y herramientas deben estar correctamente puestos a
tierra.3) Debe cubrir su mesa de trabajo con una lmina conductora puesta a tierra. Al extraer el
lector lser de su bolsa conductora, no lo coloque sobre sta. (El motivo es la posibilidadde daos a causa de la electricidad esttica.)
4) Para evitar la fuga de CA, la parte metlica del soldador deber estar puesta a tierra.5) Todos los trabajadores debern tener conexin a tierra por medio de un brazalete especial (1M )6) Tenga cuidado de no permitir que el lector lser entre en contacto con la ropa, a fin de
evitar que la electricidad esttica de sus prendas escape por el brazalete.7) El haz lser del lector NUNCA debe ser dirigido hacia los ojos o la piel desnuda.
Resistencia(1 Mohm) Lmina
conductora
Resistencia(1 Mohm)
Brazalete
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MEDIDAS DE PRECAUCIN ESDDispositivos electrostticamente sensibles (ESD)Ciertos dispositivos semiconductores (estado slido) pueden resultar fcilmente daados por la electricidadesttica. Normalmente tales componentes son conocidos comnmente como Dispositivos electrostticamentesensibles (ES) Ejemplos de dispositivos ESDtpicos son los circuitos integrados y algunos transistores de efecto campo y componentes de chips semicon-ductores. Debe utilizar las siguientes tcnicas para ayudarle a reducir las incidencias de daos en los compo-nentes causados por la electricidad esttica.1. Inmediatamente antes de manipular cualquier componente semiconductor o montaje equipado a tal efecto,
elimine cualquier carga electroesttica presente en su cuerpo tocando una puesta a tierra segura.Opcionalmente, obtenga y vista un dispositivo de muequera de descarga disponible en el mercado, quedeber retirar antes de aplicar potencia a la unidad bajo prueba a fin de evitar riesgos potenciales dedescarga elctrica.
2. Despus de retirar un montaje elctrico equipado con dispositivos ESD, coloque el montaje sobre unasuperficie conductora, como papel de aluminio, para evitar la acumulacin de cargas electroestticas o laexposicin del montaje.
3. Utilice nicamente un soldador con puesta a tierra para soldar o eliminar soldaduras en los dispositivosESD.
4. Utilice nicamente un dispositivo de eliminacin de soldaduras antiesttico. Ciertos dispositivos de elimi-nacin de soldaduras, no clasificados como antiestticos pueden generar cargas elctricas suficientescomo para daar los dispositivos ESD.
5. No utilice productos qumicos que incluya fren. Estos pueden generar cargas elctricas suficientes comopara daar los dispositivos ESD.
6. No saque un dispositivo ESD de repuesto de su embalaje protector hasta inmediatamente antes de suinstalacin. (La mayor parte de los dispositivos ESD de repuesto estn embalados con cables cortocircuita-dos elctricamente entre s mediante espuma conductora, papel de aluminio o materiales conductores simi-lares).
7. Inmediatamente antes de retirar el material protector de los cables de un dispositivo ESD de repuesto,ponga en contacto el material protector y el armazn o montaje decir cuitos en los que se instalar el dis-positivo.
PRECAUCIN: ASEGRESE DE QUE EL CHASIS O CIRCUITO NO RECIBEALIMENTACIN ELCTRICA, Y RESPETE TODAS LAS PRECAUCIONES DE SEGURIDAD.
8. Minimice los movimientos corporales durante el manejo de dispositivos ESD de repuesto ya desempaqueta-dos. (De lo contrario el movimiento inofensivo de, por ejemplo, el roce de su ropa o levantar los pies de unsuelo enmoquetado, puede generar la electricidad esttica suficiente para daar un dispositivo ESD).
PRECAUCIN. SMBOLOS GRFICOS
EL SMBOLO DEL RELMPAGO CON FLECHAS DENTRO DE UN TRINGULO EQUILTEROEST PENSADO PARA ALERTAR AL PERSONAL DE SERVICIO DE LA PRESENCIA DETENSIONES PELIGROSAS NO AISLADAS, Y QUE PUEDEN TENER LA MAGNITUDSUFICIENTE COMO PARA CONSTITUIR UN RIESGO DE DESCARGA ELCTRICA.
EL SIGNO DE EXCLAMACIN DENTRO DE UN TRINGULO EQUILTERO EST PENSADOPARA ALERTAR AL PERSONAL DE SERVICIO DE LA PRESENCIA DE INFORMACINIMPORTANTE DE SEGURIDAD EN LA DOCUMENTACIN DE SERVICIO.
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INFORMACIN DE SERVICIO PARA EEPROM(PARTE DE DVD)
ENCENDIDO
Estado LOGO DEL DVD(estado SIN disco)
Tecla Pausa del mando a distancia,en orden: -->1-->4-->7-->2.
Presione el nmero 0~9, presione laletra A~F (1~6 durante unos momentos)
Utilice la tecla de flecha ( ) paradesplazar hasta la posicin adecuada yrealizar cambios
Presione una vez la tecla Pausa
Los cambios sern aplicados cuando launidad est APAGADA-->ENCENDIDA.
DETECTAR NUEVO EEPROM(OPCIN EDITAR PANTALLA)
NAME
OPT 1OPT 2OPT 3OPT 4OPT 5OPT 6OPT 7OPT 8OPT 9OPT AOPT BOPT COPT DOPT EOPT FOPT G
HEX
434C71670205FC32EC00000000000000
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ENCENDIDO
FLD no hay disco
Pulse simultneamente durante 5 sel 2 del control remoto + STOP
delantero
FLD 00.
Utilice las teclas de direccin ( )para desplazarse y realizar cambios
Pulse una vez la tecla ENTER
FLD write ok (escritura OK) oup ok (subida OK)
Pulse simultneamente el 2 delcontrol remoto + STOP e direccin
FLD muestra E2P CLR o EP CLR
Autoapagado
NAME HEXOPT 1 66OPT 2 4AOPT 3 20OPT 4 27OPT 5 50
DETECTAR NUEVO EEPROM(OPCION EDITAR PANTALLA)
INFORMACIN DE SERVICIO PARA EEPROM(PARTE DE MICOM)
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CMO ACTUALIZAR LOS PROGRAMAS MICOM AUDIO Y DVD1. Cmo actualizar el programa MICOM AUDIO
[Actualizacin mediante CD]1. Cambie el nombre de fichero para descargarlo como (MODEL NAME)_(Version).HEX.
nicamente se permite el uso de maysculas.Ej.) HT353: HT353_0709081.HEX
2. Copie el fichero en la carpeta raz de un CD y grbelo.3. Introduzca el CD en la unidad, y dirjase a la funcin DVD. A continuacin comenzar el
proceso de actualizacin con la informacin actualizada.4. Si completa el proceso de actualizacin, la unidad se reiniciar con el mensaje Finalizado.
[Actualizacin mediante USB]1. Cambie el nombre de fichero para descargarlo como (MODEL NAME)_(Version).HEX.
nicamente se permite el uso de maysculas.Ej.) HT353: HT353_0709081.HEX
2. Copie el fichero en la carpeta raz del almacenamiento USB.3. Acople el USB a la unidad, y dirjase a la funcin USB. A continuacin comenzar el proceso
de actualizacin con la informacin actualizada.4. Si completa el proceso de actualizacin, la unidad se reiniciar con el mensaje Finalizado.
2. Cmo actualizar el programa DVD.[Actualizacin mediante CD]1. Renombre el nombre de fichero para realizar la descarga como TARGET.BIN en
maysculas.2. Copie el fichero en la carpeta \MTK_UPG\ de un CD y grbelo.
Ej.) P:\MTK_UPG\TARGET.BIN3. Introduzca el CD en la unidad y, tras unos instantes, se abrir la bandeja para CD con la
informacin de actualizacin en pantalla.4. Extraiga el CD y pulse la tecla UP (arriba) del control remoto.5. Retire y vuelva a conectar el cable de alimentacin cuando la pantalla con el logotipo pase a
mostrar informacin de actualizacin. A continuacin se completar el proceso de actualizacin.
[Actualizacin mediante USB]1. Renombre el nombre de fichero para realizar la descarga como TARGET.BIN en
maysculas.2. Copie el fichero en la carpeta \MTK_UPG\ del USB formateado y grbelo.
Ej.) P:\MTK_UPG\TARGET.BIN3. Dirjase a la funcin USB y acople el USB a la unidad. La informacin de actualizacin se
mostrar en pantalla.4. Extraiga el USB y pulse la tecla UP (arriba) del control remoto.5. Retire y vuelva a conectar el cable de alimentacin cuando la pantalla con el logotipo pase a
mostrar informacin de actualizacin. A continuacin se completar el proceso de actualizacin.
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ESPECIFICACIONES
GENERALTipo de corriente Consulte la etiqueta principalConsumo de energa Consulte la etiqueta principalPeso 2.5 kgDimensiones externas 360 x 62 x 305 mm(Ancho x Alto x Largo)Condiciones de operacin Temperatura: desde 5C hasta 35C, Estado de operacin: HorizontalHumedad para operacin 5% a 85%
AMPLIFICADORModo envolvente Frontal: 45W + 45W (potencia de salida nominal 30W, THD 10%)
Central*: 45WEnvolvente*: 45W + 45W
(potencia de salida nominal 30W, 4 at 1 kHz, THD 10%)Subwoofer*: 75W (potencia de salida nominal 60W, 8 at 30 Hz, THD 10%)
ALTAVOCES (SH33SU)Altavoz satlite/central Subwoofer Pasivo(SH33SU-S) (SH33SU-W)
Impedancia 4 8 Dimensiones netas 99 x 114 x 86 mm 156 x 325 x 320 mm(anchoxaltoxprofundo)Peso neto 0.35 kg 3.5 kg
ALTAVOCES (SH33SD)Altavoz satlite/central Subwoofer Pasivo(SH33SD-S) (SH33SD-W)
Impedancia 4 8 Dimensiones netas 99 x 114 x 86 mm 156 x 325 x 320 mm(anchoxaltoxprofundo)Peso neto 0.35 kg 3.5 kg
Los diseos y especificaciones estn sujetos a cambios sin previo aviso.
(*Dependiendo de la configuracin delmodo de sonido y de la fuente,puede no haber salida de sonido.)
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SECCIN 2. PARTE ELECTRICAGUA DE SOLUCIN DE AVERAS
1. Circuito de alimentacion
S
NO COMPROBAR ENCHUFE DEALIMENTACIN Y CIRCUITO DE ENERGA
NO COMPROBAR CIRCUITO DEENERGA
NO COMPROBAR CIRCUITODEL LSER
COMPROBAR CIRCUITO DEENFOQUE
COMPROBAR DISCO
NO COMPROBAR CIRCUITO SERVODE AJUSTE
NOCOMPROBAR CIRCUITO DE AUDIO
Se enciende el LEDrojo de potencia?
S
EST ENCENDIDO?
S
REALIZALA TAREA INICIAL DE
LECTURA?
S
INICIALA REPRODU
CCIN?S
COMPROBARCIRCUITO DE
AUDIO
S
S
ENCENDER EL EQUIPO
CONECTAR CABLE DEALIMENTACIN.
ACEPTAR
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2. Circuito frontal (1/2)
NO NOVOLVER A CONECTARLO
S
S S
COMPROBAR SI ELPN103 ES CORRECTOSe apaga el LED rojo?
NO NOCONSULTAR PARTE SMPS.
SS
COMPROBARSI LA ALIMENTACIN
FRONTAL ESCORRECTA
EL DIGITRNEST ACTIVADO CON
NORMALIDAD?
NO NO COMPROBAR PATRN YRESOLDADO
S
COMPROBARSI EL RC2 ESCORRECTO
COMPROBAR SIEL CONTROL REMOTO ES
CORRECTO
S
COMPROBAR SITODOS LOS BOTONES
FUNCIONANCORRECTAMENTE
ENCENDIDO
B/D FRONTALCORRECTO
1
2
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3. Circuito frontal (2/2)
2
NOCONSULTAR POTENCIA (SMPS).
NO
COMPROBAR CIRCUITO RM.
Comprobar sila parte de potencia frontal
es correcta.
SNO
CONSULTAR CIRCUITO MICOM.Comprobar si la forma
de onda del control remoto de la clavija 5 delPN301 es correcta.
SComprobar si
la tensin del RC2es correcta (5 V)
SVolver a soldar osustituir el RC2.
1
NOCONSULTAR POTENCIA (SMPS).
NO
Sustituir R345 ~ R350.
Comprobarsi la parte de potencia
frontal es correcta.
S
COMPROBAR SI ELR345~R350 ES CORRECTO
SCONSULTAR
CIRCUITO MICOM
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4. Flujo de funcionamiento del sistema
S
S
SEst cerradala bandeja?
1. Iinicia los registros SERVO, DSP y RISC2.Escribir el cdigo RISC en SDRAM3.Reiniciar RISC
Mostrar LOGO
Bandeja en posicin cerrada
SLED en el lado interno?
Recibe la ordenABRIR/CERRAR?
Recibe la ordenCERRAR?
SLED se desplaza a la posicin interna
1.Estimar la existencia y el tipo de disco2.Pasar al procedimiento de lectura del disco pertinente
1.Ejecutar presionar la tecla y la tecla IR2.Bucle de rutina de funcionamiento del sistema
NO
NO
NO
NO
S
1.Cesar la reproduccin y abrir la bandeja2.Mostrar mensaje de bandeja abierta y LOGO
ENCENDIDO
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5. Flujo de prueba y eliminacin de errores
S
NOComprobar PARTE DE POTENCIA
NOComprobar PARTE DE POTENCIA
PRUEBAComprobar la tensin deCA en la PCBA (110 V
220 V)
S
NOComprobar los reguladores o diodos.
NO
1. Comprobar el reloj de 27 MHz del sistema.2. Comprobar el circuito de reinicio del sistema.3. Comprobar la seal de activacin de FLASH
R/W, PRD, RWR.4. Comprobar el circuito relacionado con la
memoria FLASH.NO
Sustituir FLASH
Son correctaslas salidas de tensin CC? (12V, 5.6V,
3.5V, 5V,7V, 34V).S
Son las salidas de3.5V y 5 V de CC normales en la
PCBA principal?
S
S
Ha sido correcta laactualizacin FLASH?
S
Encender el PCBA
PRUEBA
A
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NO NOComprobar las lneas deconexin entre FLASH yMT1389/L y si el tiempo deacceso a FLASH es o nocorrecto.
S
S
S
S
Comprobar la conexin delcable de AV al equipo de TV.
S
S
S
Funcionacorrectamente la memoria
flash?
NOComprobar las lneas deconexin entre SDRAM(IC504) y MT1389/L, y si elSDRAM ha sufrido daos.
SDRAM funcionacorrectamente?
NOComprobar el circuitorelacionado de las clavijasPins99, 102, 103, 104 deMT1389/L IC50.
Son correctas lassalidas de VDEO
MT1389/L?
Mostrar el LOGO?
NO NO Es normal laseal OPEN_SW,
CLOSE_SW?
Comprobar la conexin delcable entre la PCBA principaly el cargador. (MECHA)
S
S
S
Es normal laseal OPEN_SW,
CLOSE_SW?
NO Comprobar las clavijas IO decontrol de la bandeja en
MT1389/L.Es normal la senal
TROPEN y TRCLOSE?
NO Comprobar el circuito IC401 deamplificacin de control de la
bandeja.Es normal la sealLOAD+ y LOAD -?
Se desplazala bandeja en el interior cuando no
se encuentra en posicincerrada?
ENCENDIDO
A
B
-
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NO NO Comprobar la lnea deconexin del DRV_MUTE
S
S
S
Comprobar la conexin delcable con MECHA.
No introducir un disco y cerrarla bandeja.
S
S
S
Est alta la clavijaDRV_MUTE de la unidad del
motor?
NO Comprobar el circuitorelacionado de SLEGN.
Est alta la clavijaDRV_MUTE de la unidad
del motor?
NO Comprobar el circuito deamplifi-cacin en la unidad delmotor.
Son correctas lassalidas de SLED+ y
SLED-?
Se desplaza elSOPORTE hacia el interior
cuando no se encuentraen posicin exterior?
NO NO Comprobar conexin deenfoque en MT1389/L y la
unidad del motor.
Comprobar la conexin delcable con el cabezal de
lectura.
S
S
Enfoque correctoa la unidad del motor?
NO Comprobar el circuito deamplifi-cacin en la unidad del
motor.
Son correctas lassalidas de F+ y F-?
Experimentadesplazamientos la lente
ptica para buscar elenfoque?
B
C
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Slo para uso interno de LGE 2-8
NO
NO
NOComprobar el circuito depotencia del lser en MT1389/Ly la conexin del transistor depotencia. (Q401, Q402).
S
S
S
S
S
S
Comprobar la conexin delcable entre la salida del
transistor y el lector.
Lser apagado
Comprobar la conexin RF entreAM5890 y MT1389/L.
S
S
Son correctas lassalidas del DVDLS
o CDLD?
NO Comprobar el circuitorelacionado en el transistor depotencia del lser.
Es correcta latensin del colector deltransistor de potencia?
(Q401,Q402)
Se enciendeel lser durante la lectura del
disco?
Introducir disco?
NO NO Comprobar el circuitorelacionado con el LECTOR en
MT1389/L.
Comprobar la conexin delcable entre el lector y la PCB
principal.
S
S
Es correcta la salidadel LECTOR en
MT1389/L?
NO Comprobar el circuito deamplificacin de control del
lector en la unidad del motor.Es correcta la salida
SPNP SPNN?
Gira correctamenteel lector?
NO NO Comprobar el circuitorelacionado en la seal RF del
MT1389/L.Es correcta la salida
RF en MT1389/L.Es correcta la IS del disco?
C
D
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Slo para uso interno de LGE2-9
NO NO Comprobar las conexionesentre MT1389/L y el cabezallector.
S
S
S
S
S
Comprobar la conexinCD_DVDCT entre IP9009 y
MT1389/L.
Comprobar la conexin del cableen el cabezal de lectura.
S
S
Sealescorrectas en A, B, C, D de
MT1389/L.
NO Comprobar el circuitorelacionado en la sealCD-DVDCT del MT1389/L.
Es correctala seal CD-DVDCT
en el MT1389/L.
Es correctoel enfoque ENCENDIDO?
NO Comprobar la forma de ondade la seal RF
Est el discoen reproduccin?
NO NO Comprobar el circuitorelacionado en MT1389/L.
NO Comprobar conexin de PISTAen MT1389/L y la unidad del
motor.
NOComprobar el circuito de
amplifi-cacin de control deseguimiento en la unidad
del motor.
Es correctala seal CD-DVDCT en el
MT1389/L?
S
Es correcta laseal de PISTA en
MT1389/L?
S
Es correctala salida TR+ y TR-?
Es correcta lapista actual?
D
E
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Slo para uso interno de LGE 2-10
NO NOComprobar la conexin entreIC704 BCK, LRCK, ADATAO
S
S
Comprobar circuito de amp.digital (IC702, IC703)
S
S
Recibe el PWM ICel flujo de datos de fecha
correcto?
NOComprobar el circuito rela-cionado de PWM. (Comprobarsalida de audio en las clavijasPins 55, 59, 61, 62, 68, 71, 75).
Es normal lasalida del PWM IC?
(IC704)
Es normal lasalida de audio cuando
el disco est enreproduccin?
E
TRMINO DE LA PRUEBA
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Slo para uso interno de LGE2-11
6. PROTECCIN AMP
S
NOCORRECTO.Aparece continuamente
"PROTECTION" en el FLD.
S
NOCambie el IC101.
La seal IC101de la clavija pin54 es
"LOW" (0V)?S
NORecambie Q701 y Q702.Son normales Q701 y Q702?
S
SDesconecte el cable de alimentacin y
conctelo de nuevo.
S
Encendido.
Aparece "PROTECTION" en el FLD.
Cambie el ST AMP IC (IC702, IC703).
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Slo para uso interno de LGE 2-12
7. Circuito -COM de AUDIO (DVD y AMP)
Comprobar mdulodel DVD.
Comprobar SMPS.
ACEPTAR
S
ENCENDIDO
ApareceCD/DVD en el
FLD?
S
NOAparecela Carga en elFLD?
ApareceError del DVD
en el FLD?
Does Aux,Scart, opt and FM 87.5
appear at FLD.
S
S
Aparece Sindisco o Tiempo en
el FLD?
Comprobar sila insercin Micom
de audio del DVD escorrecta.
S
Comprobarpotencia.
S
S
S
Sustituir el IC101.
SNO
NO
NO
NO
Consultar SMPS.NO
Consultar el circuito deloscilador.
NO
Comprobar el reiniciode forma de onda del
IC101.
NO
NO
S
Comprobarparte de potencia en
B/D principal.
Comprobar osciladordel X101.
Comprobarsi la clavija 5 delIC101 est alta.
S
S
S
Comprobar laexistencia de 3.3 V en
la lnea.
NO
Comprobar el circuitode la seccin de
potencia.
NO
Comprobarsi las clavijas 9,36,59 y
del IC101 estnaltas (5V).
Comprobarsi la clavija 49 delIC101 est alta.
S
-
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DETALLES Y FORMAS DE ONDA EN LAS PRUEBAS Y ELIMINACINDE ERRORES DEL SISTEMA1. SEAL DE 27 MHz DEL RELOJ, REINICIO, FLASH R/W DEL SISTEMA1) El reloj principal del MT1389/L se encuentra a 27 MHz (X501)
1
3 2
4
FIG 1-1
2) El reinicio del MT1389/L es muy activo.Entrada del cable de alimentacin
FIG 1-2
1
1
2
3
4
1
2
3
4
IC501
-
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2. RELOJ SDRAM
1) El reloj principal del MT1389/L se encuentra a 27 MHz (X501)
DCLK = 93MHz, Vp-p=2.2, Vmax=2.7V
FIG 2-1
3) Seal de activacin de flash R/W durante la descarga (descarga)
FIG 1-4
12
1
1
2
1
-
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3) Forma de onda de la bandeja abierta
FIG 3-3
3. SEAL ABRIR/CERRAR BANDEJA1) Forma de onda de la bandeja abierta/cerrada
FIG 3-1
2) Forma de onda de la bandeja cerrada
FIG 3-2
2
1
34
1
23
4
12
3
4
1
23
4
-
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4. SEAL RELACIONADA CON EL CONTROL SLED (CONDICIN SIN DISCO)
FIG 4-1
1
2
34
1
2
3
4
-
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6. SEAL RELACIONADA CON EL CONTROL DEL LSER (CONDICIN SIN DISCO)
FIG 6-1
5. SEAL RELACIONADA CON EL CONTROL DE LA LENTE (CONDICIN SIN DISCO)
FIG 5-1
1
32
132
1
2
3
12
3
-
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FIG 7-2 (DVD)
7. FORMAS DE ONDA DE ESTIMACIN DEL TIPO DE DISCO
FIG 7-1 (DVD)
1
2
3
IC501
IC501
1
2
3
1
2
3
-
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1
2
3
IC501
FIG 7-4 (CD)
FIG 7-3 (CD)
1
2
3
1
2
3
-
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FIG 8-2 (CD)
8. ATENCIN A LAS FORMAS DE ONDA
FIG 8-1 (DVD)
1
23
1
23
4
4
1
2
43
IC501
-
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9. FORMAS DE ONDA DE CONTROL DEL LECTOR (CONDICIN SIN DISCO)
FIG 9-1
10. SEAL RELACIONADA CON EL CONTROL DE SEGUIMIENTO (Comprobacin del sistema)
FIG 10-1(DVD)
1
23
1
1
2
3
1
2
3
4IC501
-
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Slo para uso interno de LGE 2-22
11. FORMAS DE ONDA DE LA SALIDA DE VDEO MT1389/L1) Seal de barra a todo color (COMPUEST.)
FIG 11-1
FIG 10-2(CD)
34
2
1
1
2
4
1
3
-
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ASDATA3
1) Audio I/D
FIG 12-1
2) Y
FIG 11-2
12. SALIDA DE AUDIO PROCEDENTE DE MT1389L
1
1 3 2
IC501
IC501
1
1
2
3
-
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Slo para uso interno de LGE 2-24
1)
R703 TP704
2)
R720 TP711
3)
R704 TP707orR717 TP705
4)
R709 TP713
5)
R707 TP702
6)
R701 TP708
13. FORMAS DE ONDA DEL DVD Y AMP
6
5
1
43
2
-
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Slo para uso interno de LGE2-25
RFH
/ O
PINN
/
RFG
/ O
PINP
/
RFIN
/ OPO
UT /
RFIP
AGN
D18
AVDD
18_1
ADACVDD2
ADACVDD1
ALF / CENTER / G
PIOALS / G
PIOAL / G
PIO1
AVCMAR
/ GPIO
0ARS / G
PIOAR
F / LFE / GPIO
AADVD
DAKIN
1 / G
PIO21 / Audio_m
uteAD
VCM / G
PIO20
/AKIN
2 / G
PIO19 / Audio_m
ute
ADAC
VSS1AD
ACVSS2
APLLCAPAPLLVD
D
AADVSS R B G
DACVDDA
DACVDDB
CVBSD
ACVSSC FS
128127126125124123122121120119118117116115114113112111110109108107106105104103102101100 99 98 97
RFA 1 96 VREFRFB 2 95 DACVDDCRFC 3 94 GPIO13RFD 4 93 SPDIF / GPIO12RFE 5 92RFF 6 91
GPIO11GPIO10
7 90AVDD18_2 DVDD18AVDD33_1 8 89 GPIO9
XTALI 9 88 GPIO8XTALO 10 87 GPIO7 / CKE
AGND33 11 86 RA3V20 12 85 RA2V14 13 84 DVDD33
REXT 14 83 RA1 MDI1 15 82 RA0MDI2 16 81 RA10LDO1 17 80 BA1LDO2 18 79 DVSS18
AVDD33_2 19 78 BA0DMO 20 77 RAS#FMO 21 76 CAS#
TRAY_OPEN 22 75 RWE#TRAY_CLOSE 23 74 RA4
TRO 24 73 RA5FOO 25 72 RA6
26 71 RA7USB_DP 27 70 RA8USB_DM 28 69 RA9
VDD33_USB 29 68 DVDD33VSS33_USB 30 67 RA11
PAD_VRT 31 66 RCLKVDD18_USB 32 65 DQM133 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64
SF_CS_
SF_DOSF_D
ISF_C
KUP1_6 / SC
LUP1_7 / SD
AIC
EPRST#IR RD
0R
D1
RD
2R
D3
RD
4D
VDD
33R
D5
RD
6R
D7
DVD
D18
DQM
0R
D15
RD
14R
D13
RD
12D
VSS33R
D11
RD
10R
D9
RD
8
MT1389L
FG / GPIO2
GPIO
3 / IN
T#G
PIO4
GPIO
6
1. IC501 MPEG(MT1389L) CONFIGURACIN DE PINS
DIAGRAMA DE BLOQUE INTERNO DE CIs
-
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Slo para uso interno de LGE 2-26
RF Amplifier
DVDPUH
Module
Servo IO
SpindleControl
ServoProcessor
MemoryController
FLASHROM
DRAM
GPIO
VideoProcessor
108MHzTV Encoder
Video DAC
CVBS, Y/CComponent
Video
SystemParser
MPEG-1/2/4JPEG
Video Decoder
AudioDSP
AudioOuptut
DebugPort
SDPIF
AudioDAC
SystemCPU
IR/VFD
De-interlacer
CPPM/CPRMDRM
32-bitRISC
MotorDrive
PCM output
Internal6ch Audio DACs
6ch Audio Analogoutputs
Audio Mic1
Audio Mic2Internal
Audio ADC
USB 2.0 HighSpeed
controller
MS/SD/MMCCard
Controller
USB 2.0 High/ Full Speed
Device
MS/SD/MMCFlash Card
1. IC501 MPEG(MT1389L) DIAGRAMA DE BLOQUE
-
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Slo para uso interno de LGE2-27
1. IC501 MPEG(MT1389L) DESCRIPCIN DE PINS
Pin Main Alt. Type DescriptionAnalog I nterface (66)
125 RFIP Analog Input AC coupled DVD RF signal input RFIP126 RFIN OPOUT Analog Input AC coupled DVD RF signal input RFIN127 RFG OPINP Analog Input Main beam, RF AC input path128 RFH OPINN Analog Input Main beam, RF AC input path1 RFA Analog Input RF main beam input A2 RFB Analog Input RF main beam input B3 RFC Analog Input RF main beam input C4 RFD Analog Input RF main beam input D5 RFE Analog Input RF sub beam input E6 RFF Analog Input RF sub beam input E7 AVDD18_2 Analog power Analog 1.8V power8 AVDD33_1 Analog power Analog 3.3V power9 XTALI Input 27MHz crystal input10 XTALO Output 27MHz crystal output11 AGND33 Analog Ground Analog Ground12 V20 Analog output Reference voltage 2.0V13 V14 Analog output Reference voltage 1.4V
14 REXT Analog InputCurrent reference input. It generates reference current for RF path. Connect an external 15K resistor to this pin and AVSS
15 MDI1 Analog Input Laser power monitor input16 MDI2 Analog Input Laser power monitor input17 LDO1 Analog Output Laser driver output18 LDO2 Analog Output Laser driver output19 AVDD33_2 Analog Power Analog 3.3V power20 DMO Analog Output Disk motor control output. PWM output21 FMO Analog Output Feed motor control. PWM output22 TRAY_OPEN Analog Output Tray PWM output/Tray open output23 TRAY_CLOSE Analog Output Tray PWM output/Tray close output
24 TRO Analog Output Tracking servo output. PDM output of tracking servo compensator
25 FOO Analog Output Focus servo output. PDM output of focus servo compensator
26 FG GPIO2 Analog 1) Motor Hall sensor input 2) GPIO27 USB_DP Analog Input USB port DPLUS analog pin28 USB_DM Analog Input USB port DMINUS analog pin29 VDD33_USB USB Power USB Power pin 3.3V30 VSS33_USB USB Ground USB ground pin31 PAD_VRT Analog Inout USB generating reference current32 VDD18_USB USB Power USB Power pin 1.8V95 DACVDDC Power Power96 VREF Analog Bandgap reference voltage97 FS Analog Full scale adjustment (suggest to use 560 ohm)98 DACVSSC Ground Ground pin for video DAC circuitry99 CVBS Analog Analog composite output
Abbreviations:SR: Slew RatePU: Pull UpPD: Pull DownSMT: Schmitt Trigger4mA~16mA: Output buffer driving strength.
-
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Slo para uso interno de LGE 2-28
Pin Main Alt. Type Description100 DACVDDB Power 3.3V power pin for video DAC circuitry101 DACVDDA Power 3.3V power pin for video DAC circuitry102 Y/G Analog Green, Y, SY, or CVBS103 B/CB/PB Analog Blue, CB/PB, or SC104 R/CR/PR Analog Red, CR/PR, CVBS, or SY105 AADVSS Ground Ground pin for 2ch audio ADC circuitry
` 1) Audio ADC input 2 2) MS_CLK set B3) MCDATA
106 AKIN2 Analog 4) Audio Mute 5) HSYN/VSYN output 6) C5 7) GPIO1) 2ch audio ADC reference voltageC
107 ADVCM Analog 2) C63) GPIO1) Audio ADC input 1 2) MS_D0 set B 3) Audio Mute 108 AKIN1 Analog4) HSYN/VSYN output 5) C7 6) GPIO
109 AADVDD Power 3.3V power pin for 2ch audio ADC circuitry110 APLLVDD3 Power 3.3V Power pin for audio clock circuitry111 APLLCAP Analog InOut APLL external capacitance connection112 ADACVSS2 Ground Ground pin for audio DAC circuitry113 ADACVSS1 Ground Ground pin for audio DAC circuitry
114 ARF / LFE GPIO Analog Output
1) Audio DAC sub-woofer channel output 2) While internal audio DAC not used:a. ACLK b. GPIO
115 ARS GPIO Analog Output1) Audio DAC right Surround channel output2) While internal audio DAC not used:a. ABCKb. GPIO1) Audio DAC right channel output2) While internal audio DAC not used:
116 AR Analog Output a. SDATA2b. GPIOc. RXD2
117 AV CM Analog Audio DAC reference voltage
118 AL GPIO Analog Output
1) Audio DAC left channel output2) While internal audio DAC not used:a. SDATA1b. GPIOc. RXD1
119 ALS GPIO Analog Output1) Audio DAC left Surround channel output2) While internal audio DAC not used:a. ALRCKb. GPIO
120 ALF /CENTER GPIO Analog Output
1) Audio DAC center channel output2) While internal audio DAC not used:a. ASDATA0b. GPIO
121 ADACVDD1 Analog Power 3.3V power pin for audio DAC circuitry122 ADACVDD2 Analog Power 3.3V power pin for audio DAC circuitry123 AVDD18_1 Analog Power Analog 1.8V power124 AGND18 Analog Ground Analog Ground
General Power/ Ground (7)54, 90 DVDD18 Power 1.8V power pin for internal digital circuitry
-
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Slo para uso interno de LGE2-29
Pin Main Alt. Type Description79 DVSS18 Ground 1.8V Ground pin for internal digital circuitry
50, 68,84 DVDD33 Power 3.3V power pin for internal digital circuitry60 DVSS Ground 3.3V Ground pin for internal digital circuitry
Micro Controller , Flash I nterface and GPIO(12)
33 GPIO3 INT#InOut 1) General purpose IO 38mA, SR 2) Microcontroller external interrupt 1PD, SMT
34 GPIO4InOut
General purpose IO 44mA, PD
35 GPIO6InOut
General purpose IO 64mA, PD
36 SF_CS_InOut8mA, SR Serial Flash Chip SelectPU, SMT
37 SF_DOInOut8mA, SR Serial Flash DoutPD, SMT
38 SF_DIInOut8mA, SR Serial Flash DinPU, SMT
39 SF_CKInOut8mA, SR Serial Flash ClockPD, SMT
40 UP1_6 SCLInOut 1) Microcontroller port 1-68mA, SR 2) I2C clock pinPU, SMT
41 UP1_7 SDAInOut 1) Microcontroller port 1-74mA, SR 2) I2C data pinPU, SMT
42 ICEInput
Microcontroller ICE mode enablePD, SMT
43 PRST#Input
Power on reset input, active lowPU, SMT
44 IRInput
IR control signal inputSMTDram Interface (37) (Sorted by position)
45 RD0InOut
DRAM data 04mA
46 RD1InOut
DRAM data 14mA
47 RD2InOut
DRAM data 24mA
48 RD3InOut
DRAM data 34mA
49 RD4InOut
DRAM data 44mA
51 RD5InOut
DRAM data 54mA
52 RD6InOut
DRAM data 64mA
53 RD7InOut
DRAM data 74mA
55 DQM0InOut
Data mask 04mA, PD
56 RD15InOut
DRAM data 154mA
57 RD14InOut
DRAM data 144mA
58 RD13InOut
DRAM data 134mA
-
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Slo para uso interno de LGE 2-30
Pin Main Alt. Type Description
59 RD12InOut
DRAM data 124mA
61 RD11InOut
DRAM data 114mA
62 RD10InOut
DRAM data 104mA
63 RD9InOut
DRAM data 94mA
64 RD8InOut
DRAM data 84mA
65 DQM1InOut
Data mask 14mA, PD
66 RCLKInOut
Dram clock4mA, PD
67 RA11InOut
DRAM address bit 114mA, PD
69 RA9InOut
DRAM address 94mA, PD
70 RA8InOut
DRAM address 84mA, PD
71 RA7InOut
DRAM address 74mA, PD
72 RA6InOut
DRAM address 64mA, PD
73 RA5InOut
DRAM address 54mA, PD
74 RA4InOut
DRAM address 44mA, PD
75 RWE#Output
DRAM Write enable, active low4mA, PD
76 CAS#Output
DRAM column address strobe, active low4mA, PD
77 RAS#Output
DRAM row address strobe, active low4mA, PD
78 BA0InOut
DRAM bank address 04mA, PD
80 BA1InOut
DRAM bank address 14mA, PD
81 RA10InOut
DRAM address 104mA, PD
82 RA0InOut
DRAM address 04mA, PD
83 RA1InOut
DRAM address 14mA, PD
85 RA2InOut
DRAM address 24mA, PD
86 RA3InOut
DRAM address 34mA, PD1) GPIO 72) Dram Clock Enable
87 GPIO7 CKE InOut 3) MS_CLK set A4mA, PD 4) Audio Mute5) HSYN/VSYN input6) C0
GPIO (6)
88 GPIO8
1) GPIO82) MS_BS set A
InOut 3) SD_CLK set A4mA, PD 4) ASDATA2
5) ACLK
-
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Slo para uso interno de LGE2-31
Pin Main Alt. Type Description6) Audio Mute7) HSYN/VSYN input8) C11) GPIO92) MS_D0 set A
89 GPIO9 InOut 3) SD_CMD set A4mA, PD 4) ASDATA1
5) ABCK6) C27) RXD11) GPIO102) SD_CLK set B3) SD_D0 set A
91 GPIO10 InOut 4) ASDATA04mA, PD 5) ALRCK6) HSYN/VSYN output7) C38) TXD11) GPIO112) SD_CMD set B
92 GPIO11InOut 3) MS_BS set B4mA, PD 4) Audio Mute
5) HSYN/VSYN output6) C4
93 SPDIF GPIO12InOut 1) SPDIF output2mA, PD 2) GPIO12
1) GPIO13
94 GPIO13InOut 2) SD_D0 set B4mA, PD 3) ALRCK
4) Audio Mute5) YUVCLK
-
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Slo para uso interno de LGE 2-32
2. IC401 MOTOR DRIVER
CONFIGURACIN DE PINS
DIAGRAMA DE BLOQUE
-
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Slo para uso interno de LGE2-33
1. IC501 MPEG(MT1389L) DESCRIPCIN DE PINS
-
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Slo para uso interno de LGE 2-34
3. IC101 MICOM1389L) CONFIGURACIN DE PINS
P83/
AN3
P84/
AN4
P85/
AN5
P86/
AN6
PC0
PC1
PC2
PC3
PC4
PC5/
DBG
P0PC
6DBG
P1PC
7/DB
GP2
V DD
3V S
S3P3
0P3
1LC87F5M64A
495051
52
5354
55
5657
58596061626364
323130292827
2625
24
2322
21
20191817
48 41
161514131211109876541 2 3
33343536373839404243444547 46
P70/INT0/T0LCP/AN8P71/INT1/T0HCP/AN9
P72/INT2/T0IN/NKINP73/INT3/T0IN
RESXT1/AN10XT2/AN11
VSS1CF1CF2
VDD1
P80/AN0P81/AN1P82/AN2P10/SO0
P11/SI0/SB0
P32/UTX1P33/URX1P34/UTX2P35/URX2P36P37P27/INT5/T1INP26/INT5/T1INP25/INT5/T1INP24/INT5/T1IN/INT7P23INT4/T1INP22/INT4/T1INP21/INT4/T1INP20/INT4/T1IN/INT6P07/T7OP06/T6O
P12/
SCK0
P13/
SO1
P14/
SI1/
SB1
P15/
SCK1
P16/
T1PW
ML
P17/
T1PW
MH/
BUZ
PWM
2
PWM
3V D
D2
V SS2 P0
0P0
1P0
2P0
3P0
4P0
5/CK
O Top view
-
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Slo para uso interno de LGE2-35
DIAGRAMA DE BLOQUE
Interrupt control
Standby control
IR PLA
Bus interface
Port 0
Port 1
SIO0
SIO1
Timer 0
Timer 1
Timer 4
Timer 5
Port 2
Port 7
Port 8
ADC
ALU
Flash ROM
PC
ACC
B register
C register
PSW
RAR
RAM
Stack pointer
Watchdog timer
CF
RC
Xtal
MRC
Cloc
kge
nera
tor
UART2 On-chip Debugger
ROM correct
PWM2/3
UART1
Base timer
Port C
Timer 6
INT0 to INT7Noise filter
Port 3
Timer 7
-
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Slo para uso interno de LGE 2-36
1. IC501 MPEG(MT1389L) DESCRIPCIN DE PINS
Pin Name I/O Description OptionVSS1, VSS2VSS3
- - Power supply pin No
VDD1, VDD2VDD3
- + Power supply pin No
Port 0
P00 to P07
I/O 8-bit I/O port I/O specifiable in 4-bit units Pull-up resistor can be turned on and off in 4-bit units HOLD release input Port 0 interrupt input Shared Pins
P05 : Clock output (system clock / can selected from sub clock)P06 : Timer 6 toggle outputP07 : Timer 7 toggle output
Yes
Port 1
P10 to P17
I/O 8-bit I/O port I/O specifiable in 1-bit units Pull-up resistor can be turned on and off in 1-bit units Pin functions
P10 : SIO0 data outputP11 : SIO0 data input/bus I/OP12 : SIO0 clock I/OP13 : SIO1 data outputP14 : SIO1 data input/bus I/OP15 : SIO1 clock I/OP16 : Timer 1 PWML outputP17 : Timer 1 PWMH output/beeper output
Yes
Port 2 8-bit I/O port I/O specifiable in 1-bit units Pull-up resistor can be turned on and off in 1-bit units Other functions
P20: INT4 input/HOLD reset input/timer 1 event input/timer 0L capture input/timer 0H capture input/INT6 input/timer 0L capture 1 input
P21 to P23 : INT4 input/HOLD reset input/timer 1 event input/timer 0L capture input/timer 0H capture input
P24: INT5 input/HOLD reset input/timer 1 event input/timer 0L capture input/timer 0H capture input/INT7 input/timer 0H capture 1 input
P25 to P27: INT5 input/HOLD reset input/timer 1 event input/timer 0L capture input/ timer 0H capture input
Interrupt acknowledge type
Rising FallingRising/Falling
H level L level
INT4INT5INT6INT7
enableenableenableenable
enableenableenableenable
enableenableenableenable
disabledisabledisabledisable
disabledisabledisabledisable
P20 to P27
I/O Yes
-
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Slo para uso interno de LGE2-37
Pin Name I/O Description OptionPort 7 4-bit I/O port
I/O specifiable in 1-bit units Pull-up resistor can be turned on and off in 1-bit units Shared pins
P70 : INT0 input/HOLD reset input/timer 0L capture input/watchdog timer output P71 : INT1 input/HOLD reset input/timer 0H capture inputP72 : INT2 input/HOLD reset input/timer 0 event input/timer 0L capture input/
high speed clock counter inputP73 : INT3 input (with noise filter)/timer 0 event input/timer 0H capture inputAD converter input port: AN8 (P70), AN9 (P71)
Interrupt acknowledge type
Rising FallingRising/Falling
H level L level
INT0 enable enable disable enable enableINT1 enable enable disable enable enableINT2 enable enable enable disable disableINT3 enable enable enable disable disable
P70 to P73
I/O No
Port 8
P80 to P86
I/O 7-bit I/O port I/O specifiable in 1-bit units Shared pins
AD converter input port : AN0 (P80) to AN6 (P86)
No
PWM2PWM3
I/O PWM2 and PWM3 output ports General-purpose I/O available
No
Port 3
P30 to P37
I/O 8-bit I/O port I/O specifiable in 1-bit units Pull-up resistor can be turned on and off in 1-bit units Pin functions
P32: UART1 transmitP33: UART1 receiveP34: UART2 transmitP35: UART2 receive
Yes
Port C PC0 to PC7
I/O 8-bit I/O port I/O specifiable in 1-bit units Pull-up resistor can be turned on and off in 1-bit units Pin functions
PC5 to PC7: On-chip Debugger
Yes
RES Input Reset pin NoXT1 Input 32.768kHz crystal oscillator input pin
Shared pinsGeneral-purpose input portAD converter input port : AN10
Must be connected to VDD1 if not to be used.
No
XT2 I/O 32.768kHz crystal oscillator output pin Shared pins
General-purpose I/O portAD converter input port : AN11
Must be set for oscillation and kept open if not to be used.
No
CF1 Input Ceramic resonator input pin NoCF2 Output Ceramic resonator output pin No
-
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Slo para uso interno de LGE 2-38
4. IC201 ADC(CS5345) CONFIGURACIN DE PINS
1
2
3
4
5
6
7
8
910
11
12
13 14 15 16 17 18 19 20 21 22 23 24
48 47 46 45 44 43 42 41 40 39 38 37
36
3534
3332
31
3029
2827
2625
VLSSDA/CDOUT
AGND
OVF
L
SCL/CCLK
AD0/CSAD1/CDIN
VLCRESET
AIN3A
AIN3B
AIN2A
AIN2B
AIN1A
AIN1B
VA
AFIL
TB VQTS
TO
FILT
+
TSTO
AIN
4A/M
ICIN
1AI
N4B
/MIC
IN2
AIN
5A
AIN
5B
AFIL
TA
TSTONCNC
AGNDAGND
VA
PGAOUTBPGAOUTA
AIN6B
AIN6A
MICBIAS
INT
VD DG
NDM
CLK
LRCK
SCLK
SDO
UTN
C
NC
NC
TSTI
CS5345
-
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Slo para uso interno de LGE2-39
VLS0.1 F+1.8Vto +5V
DGND
VLC0.1 F
+1.8Vto +5V
SCL/CCLKSDA/CDOUTAD1/CDIN
RESET
2 k See Note 1
AGND
AD0/CS
Note 1: Resistors are requiredfor IC control port operation
Micro-Controller
0.1 F
VA
* Capacitors must be C0G or equivalent
Digital AudioCapture LRCK
SDOUT
MCLKSCLK
PGAOUTA
PGAOUTB
2.2nFAFILTAAFILTB
OVFL
2.2nF
3.3 F
3.3 F
47 F0.1 F
VQFILT+
10 F
AGND
* *
2 k
INT
47 F
AIN1A Left Analog Input 110 F
10 F
1800 pF
1800 pF
100 k
100 k 100
100
AIN1B Right Analog Input 1
AIN2A Left Analog Input 210 F
10 F
1800 pF
1800 pF
100 k
100 k 100
100
AIN2B Right Analog Input 2
AIN3A Left Analog Input 310 F
10 F
1800 pF
1800 pF
100 k
100 k 100
100
AIN3B Right Analog Input 3
AIN4A/MICIN1 Left Analog Input 410 F
10 F
1800 pF
1800 pF
100 k
100 k 100
100
AIN4B/MICIN2 Right Analog Input 4
AIN5A Left Analog Input 510 F
10 F
1800 pF
1800 pF
100 k
100 k 100
100
AIN5B Right Analog Input 5
AINA Left Analog Input ;10 F
10 F
1800 pF
1800 pF
100 k
100 k 100
100
AIN6B Right Analog Input 6
MICBIAS
AGND
0.1 F
*
*
*
*
*
*
*
*
*
*
*
*
NCNCNCNCNC
TSTITSTOTSTOTSTO
10 F+3.3V to +5V
0.1 F10 F 0.1 F
VAVD
+3.3V to +5V
RL
See Note 2
Note 2 The value of RL isdictated by the microphonecarteridge.
4. IC201 ADC(CS5345) DIAGRAMA DE BLOQUE
-
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Slo para uso interno de LGE 2-40
AIN1AAIN1B
1112
Stereo Analog Input 1 (Input) - The full-scale level is specified in the ADC Analog Characteristics specification table.
AGND 13 Analog Ground (Input) - Ground reference for the internal analog section.VA 14 Analog Power (Input) - Positive power for the internal analog section.AFILTA 15 Antialias Filter Connection (Output) - Antialias filter connection for the channel A ADC input.AFILTB 16 Antialias Filter Connection (Output) - Antialias filter connection for the channel B ADC input.VQ 17 Quiescent Voltage (Output) - Filter connection for the internal quiescent reference voltage.TSTO 18 Test Pin (Output) - This pin must be left unconnected.FILT+ 19 Positive Voltage Reference (Output) - Positive reference voltage for the internal sampling circuits.TSTO 20 Test Pin - This pin must be left unconnected.AIN4A/MICIN1AIN4B/MICIN2
2122
Stereo Analog Input 4 / Microphone Input 1 & 2 (Input) - The full-scale level is specified in the ADC Analog Characteristics specification table.
AIN5AAIN5B
2324
Stereo Analog Input 5 (Input) - The full-scale level is specified in the ADC Analog Characteristics specification table.
MICBIAS 25 Microphone Bias Supply (Output) - Low-noise bias supply for external microphone. Electrical charac-teristics are specified in the DC Electrical Characteristics specification table.AIN6AAIN6B
2627
Stereo Analog Input 6 (Input) - The full-scale level is specified in the ADC Analog Characteristics specification table.
PGAOUTAPGAOUTB
2829
PGA Analog Audio Output (Output) - Either an analog output from the PGA block or high impedance.
VA 30 Analog Power (Input) - Positive power for the internal analog section.
AGND 3132 Analog Ground (Input) - Ground reference for the internal analog section.
NC 3334No Connect - These pins are not connected internally and should be tied to ground to minimize any potential coupling effects.
TSTO 35 Test Pin (Output) - This pin must be left unconnected.
VLS 36 Serial Audio Interface Power (Input) - Determines the required signal level for the serial audio inter-face. Refer to the Recommended Operating Conditions for appropriate voltages.TSTI 37 Test Pin (Input) - This pin must be connected to ground.
NC38,39,40
No Connect - These pins are not connected internally and should be tied to ground to minimize any potential coupling effects.
SDOUT 41 Serial Audio Data Output (Output) - Output for twos complement serial audio data.SCLK 42 Serial Clock (Input/Output) - Serial clock for the serial audio interface.
LRCK 43 Left Right Clock (Input/Output) - Determines which channel, Left or Right, is currently active on the serial audio data line.
MCLK 44 Master Clock (Input/Output) - Clock source for the ADCs delta-sigma modulators.DGND 45 Digital Ground (Input) - Ground reference for the internal digital section.VD 46 Digital Power (Input) - Positive power for the internal digital section.INT 47 Interrupt (Output) - Indicates an interrupt condition has occurred.OVFL 48 Overflow (Output) - Indicates an ADC overflow condition is present.
Pin Name # Pin Description
SDA/CDOUT 1 Serial Control Data (Input/Output) - SDA is a data I/O in IC
Mode. CDOUT is the output data line for the control port interface in SPITM Mode.
SCL/CCLK 2 Serial Control Port Clock (Input) - Serial clock for the serial control port.
AD0/CS 3 Address Bit 0 (IC) / Co ntrol Port Chip Select (SPI) (Input) - AD0 is a chip address pin in IC Mode; CS is the chip-select signal for SPI format.
AD1/CDIN 4 Address Bit 1 (IC) / Ser ial Control Data Input (SPI) (Input) - AD1 is a chip address pin in IC Mode; CDIN is the input data line for the control port interface in SPI Mode.
VLC 5 Control Port Power (Input) - Determines the required signal level for the control port interface. Refer to the Recommended Operating Conditions for appropriate voltages.RESET 6 Reset (Input) - The device enters a low-power mode when this pin is driven low. AIN3AAIN3B
78
Stereo Analog Input 3 (Input) - The full-scale level is specified in the ADC Analog Characteristics specification table.
AIN2AAIN2B
910
Stereo Analog Input 2 (Input) - The full-scale level is specified in the ADC Analog Characteristics specification table.
1. IC501 MPEG(MT1389L) DESCRIPCIN DE PINS
-
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Slo para uso interno de LGE2-41
5. IC704 PWM
CONFIGURACIN DE PINS
DIAGRAMA DE BLOQUE
PLL
PWMModulator
Internal Controls
MLRCKMBCK
MSDIN[0:3]
SCK/SCLSO/SDA
SI/I2C_AD0/CS/I2C_AD2
PWM2_P/MPWM3_P/MPWM4_P/MPWM5_P/MPWM6_P/M
/RES
ET
OVERLOADEXT_MUTE
PWM1_P/M
PWM8_P/M
Internal ClockSPI/I2C
PWM7_P/M
SLRCKSBCK
SSDIN[0:3]
PWM_HP_R_P/MPWM_HP_L_P/M
EPD_ENA
PWM_SWL_P/M
MIC_LRCKMIC_BCK
MIC_SDIN
MIC_MCLK
DMIX_MCLKOLRCKOBCKDMIX_SDOUT
PLL_
DVD
D
PLL_
DVSS
PLL_
AVDD
PLL_
AVSS
DVDD
DVSS
IO_V
DD
IO_VS
S
Power Supply
Reset & Power Down
Internal Reset
Serial AudioOutput
interface
AutomaticGain
Limiter
MainVolume
TrimVolume
BassManagerEQ
DownMixer
MixerMic.Input
Processor
InputMapper
SampleRate
Converter
Input&
OutputMUX
HostInterface(I2C, SPI)
SerialAudioOutput
interface
Outp
ut M
appe
r
POPNRCrystal
Oscillator
XIN
XOUT
IO
_VD
D
PLL_
DVD
D
IO_V
SS
IO_
VSS
PLL_
AVD
D
IO
_VSS
PLL_
AVSS
PLL_
DVS
S
MLR
CK
MBC
K
MSD
IN0
MIC_LRCK
MIC_BCK
MIC_MCLK
PWM_HP_R_P
IO_
VSS
PWM
2_P
PWM
2_M
PWM
3_P
PWM
3_M
PWM
4_P
PWM
4_M
SPI/I2C
/CS/I2C_AD2
SI/I2C_AD0
SO/SDA
SCK/SCL
/RESET
SCAN_ENA
XIN
DVSS
IO_VSS
IO_V
SS
IO_
VSS
DVDD
DVS
S
IO_V
DD
IO_
VSS
MSD
IN1
MSD
IN2
SLRC
K
SBCK
DVS
S
PWM
5_P
PWM
5_M
DVD
D
TEST_MODE3
DVSS
IO_
VSS
PWM
6_P
PWM
6_M
IO_
VSS
IO_V
SS
PWM1_P
PWM1_M
OVERLOAD
IO_VSS
IO_VSS
SSD
IN1
EXT_MUTE
DVDD
IO_V
DD
DVD
D
SSD
IN0
MSD
IN3
SSD
IN2
SSDIN3
IO_VSS
IO_VDD
MIC_SDIN
PWM_SWL_P
PWM_SWL_M
PWM_HP_L_P
PWM_HP_L_M
PWM_HP_R_M
IO_
VSS
PWM
7_P
PWM
7_M
PWM
8_P
PWM
8_M
EPD_ENA
TEST_MODE2
TEST_MODE1
IO_VSS
DMIX_LRCK
DMIX_BCK
DMIX_SDOUT
DMIX_MCLK
98
99
100
96
97
93
94
95
91
92
85
86
87
88
89
90
83
84
81
82
7172737475 61626364656667686970 53545556575859 515260
46
47
48
49
50
9 10 11 12 13 14 15 161 2 3 4 5 6 7 8
30
31
32
33
34
35
36
37
26
27
28
29
76
77
78
79
80
17 18 19 20
38
39
40
41
42
43
44
45
21 22 23 24 25
IO_V
DD
IO_VSS
IO_VDD
DVDD
DVSS
IO_VDD
IO_V
DD
IO_V
DD
DVSS
DVDD
IO_VDD
PULSUSXOUT
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Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE 2-42
1. IC501 MPEG(MT1389L) DESCRIPCIN DE PINS
Name Pin NO. Type Description Power and Ground
PLL_AVDD 6 Analog Power
PLL analog power supply.
PLL_AVSS 8 Analog Ground
PLL analog ground.
PLL_DVDD 3 PLL Power
PLL digital power supply.
PLL_DVSS 2 PLL Ground
PLL digital ground.
DVDD 13, 34, 42, 66, 80, 91
Power Core power supply.
DVSS 14, 35, 43, 63, 81, 92
Ground Core digital ground.
IO_VDD 4, 10, 22, 29, 39, 47,
56, 65, 72, 94
Power I/O power supply. 3.3V Digital power supply.
IO_VSS 1, 5, 7, 9, 21, 28, 38, 44, 50, 53, 57, 60, 64, 69, 73, 85, 95
Ground I/O digital ground.
Reset and Clock /RESET 96 I H/W reset signal. Active Low Schmitt-Trigger input.
The Schmitt-Trigger input allows a slowly rising input to reset the chip reliably. The RESET signal must be asserted Low during power up. De-assert High for normal operation.
XIN 86 Analog Crystal Oscillator input pin. XOUT 87 Analog Crystal Oscillator output pin.
PCM Audio Input/Output Interface MBCK 11 I/O PCM bit clock input/output of main 8-channel audio.
User can select the master/slave mode of this signal. Schmitt-Trigger input.
MLRCK 12 I/O PCM Word clock (left-right clock) input/output of main 8-channel audio. User can select the master/slave mode of this signal. Schmitt-Trigger input.
MSDIN [3:0] 15, 16, 17, 18 I PCM serial data input of main 8-channel audio. Schmitt-Trigger input.
SBCK 19 I/O PCM bit clock input/output of 8-channel audio. User can select the master/slave mode of this signal. Schmitt-Trigger input.
SLRCK 20 I/O PCM word clock (left-right clock) input/output of sub 8-channel audio. User can select the master/slave mode of this signal. Schmitt-Trigger input.
SSDIN [3:0] 23, 24, 25, 26 I/O PCM serial data input of sub-channel audio. User can set this sub-channel data input pins to PCM serial data output pins. See the Control Register Description part. Schmitt-Trigger input
-
Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE2-43
MIC_MCLK 30 O Main clock for external microphone input A/DC. Clock frequency can be selected between 6.144MHz, 12.288MHz, and 24.576MHz.
MIC_BCK 31 I/O PCM bit clock input/output of external microphone. Bit clock frequency is 3.072MHz (48kHz x 64, fixed)
MIC_LRCK 32 I/O PCM Word clock (left-right clock) input/output of external microphone. Word clock rate is 48kHz (fixed).
MIC_SDIN 33 I PCM serial data input of external microphone. Schmitt-Trigger input.
DMIX_MCLK 93 O Main clock for external down-mix line output D/AC. DMIX_BCK 89 O PCM bit clock output of down-mix signal.
Bit clock frequency is 6.144MHz (96kHz x 64, fixed) DMIX_LRCK 88 O PCM Word clock (left-right clock) output of down-mix signal.
Word clock rate is 96kHz (fixed). DMIX_SDOUT 90 O PCM serial data output of down-mix signal.
PWM Audio Output PWM1_P 49 O Positive PWM output of channel 1. PWM1_M 48 O Negative PWM output of channel 1. PWM2_P 52 O Positive PWM output of channel 2. PWM2_M 51 O Negative PWM output of channel 2. PWM3_P 55 O Positive PWM output of channel 3. PWM3_M 54 O Negative PWM output of channel 3. PWM4_P 59 O Positive PWM output of channel 4. PWM4_M 58 O Negative PWM output of channel 4. PWM5_P 62 O Positive PWM output of channel 5. PWM5_M 61 O Negative PWM output of channel 5. PWM6_P 68 O Positive PWM output of channel 6. PWM6_M 67 O Negative PWM output of channel 6. PWM7_P 71 O Positive PWM output of channel 7. PWM7_M 70 O Negative PWM output of channel 7. PWM8_P 75 O Positive PWM output of channel 8. PWM8_M 74 O Negative PWM output of channel 8.
PWM_HP_L_P 46 O Positive PWM output of headphone left channel. PWM_HP_L_M 45 O Negative PWM output of headphone left channel. PWM_HP_R_P 41 O Positive PWM output of headphone right channel. PWM_HP_R_M 40 O Negative PWM output of headphone right channel. PWM_SWL_P 37 O Positive PWM output of subwoofer line output. PWM_SWL_M 36 O Negative PWM output of subwoofer line output.
System Control Interface SPI/I2C 84 I Host interface mode (SPI or I2C) selector.
Assert HIGH for SPI mode. De-assert LOW for I2C mode. Internal pull-down resistor.
SO/SDA 78 I/O SO for SPI mode or SDA for I2C mode.
-
Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE 2-44
SCK/SCL 79 I SCK for SPI mode or SCL for I2C mode. Schmitt-Trigger input.
SI/I2C_AD0 82 I SI for SPI mode or Slave Address 0 for I2C mode. Schmitt-Trigger input. Internal pull-down resistor.
/CS/I2C_AD2 83 I Chip selector (CS) for SPI mode or Slave Address 2 for I2C mode.Schmitt-Trigger input. Internal pull-down resistor.
Special Control Interface EXT_MUTE 27 I External mute control input. Active High.
Assert HIGH to mute audio output. Internal pull-down resistor.
OVERLOAD 76 I Power stage overload indication input. Polarity is programmable. Schmitt-Trigger input. When OVERLOAD is asserted, all PWM audio outputs go to LOW. That shutdown process is programmable. Internal pull-down resistor.
EPD_ENA 77 O External amplifier power device enable output. Active High. Test Mode
TEST_MODE1 97 I Test mode selection pin 1. In normal operation, it should be LOW or not connected. Internal pull-down resistor.
TEST_MODE2 98 I Test mode selection pin 2. In normal operation, it should be LOW or not connected. Internal pull-down resistor.
SCAN_ENA 99 I Scan enable. Active High. In normal operation, it should be LOW or not connected. Internal pull-down resistor.
TEST_MODE3 100 I Test mode selection pin 3. In normal operation, it should be LOW or not connected. Internal pull-down resistor.
All inputs and bi-directional inputs are 5 Volt tolerant. The corresponding pins can be connected to the buses that can swing between 0V and 5V. The output-only pins are not 5V tolerant and the buses they are connected to can swing only between 0V and 3.3V.
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Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE2-45 2-46
DIAGRAMA DE CABLEADO
2007. 11. 30
PN202
CABLE1
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Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE 2-47 2-48
DIAGRAMA DE BLOQUE
2007. 11. 30
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Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE
2007. 11. 30
A
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6
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8
9
10
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B C D E F G H I J K L M N O P Q R S T
NOTES) Symbol denotes DC chassis ground.
NOTE) WarningNOTE) Parts that are shaded are criticalNOTE) With respect to risk of fire orNOTE) electricial shock.
2-49 2-50
DIAGRAMAS DE CIRCUITO1. DIAGRAMA DEL CIRCUITO SMPS (POTENCIA) AVISO IMPORTANTE DE SEGURIDADAL REALIZAR LABORES DE MANTENIMIENTO EN ESTE
ARMAZN NO MODIFIQUE NI ALTERE, BAJO NINGUNACIRCUNSTANCIA, EL DISEO ORIGINAL SIN EL PERMISOESCRITO DE LG ELECTRONICS CORPORATION. TODOS LOSCOMPONENTES DEBEN SUSTITUIRSE NICAMENTEPOR OTROS DE UN TIPO IDNTIDO A LOS ORIGINALES.
LOS COMPONENTES ESPECIALES APARECENSOMBREADOS EN EL ESQUEMA PARA FACILITARSU IDENTIFICACIN. EN OCASIONES, ESTEDIAGRAMA DE CIRCUITO PUEDE DIFERIR DELCIRCUITO UTILIZADO. DE ESTA FORMA, LA APLICACINDE LAS LTIMAS MEJORAS EN SEGURIDAD YRENDIMIENTO NO SE RETRASAR HASTA LA IMPRESINDE LOS NUEVOS DOCUMENTOS DE SERVICIO.
NOTE :1. Las piezas sombreadas( ) resultan crticas para la seguridad.
Sustituir nicamente por el n de pieza especificado.2. Las tensiones CC se miden con un voltmetro digital
durante el modo de reproduccin.
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Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE 2-51 2-52
2. DIAGRAMA DEL CIRCUITO DE MPEG
2007. 11. 30
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Slo para uso interno de LGE2-53 2-54
3. DIAGRAMA DEL CIRCUITO SERVO
2007. 11. 30
A
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Slo para uso interno de LGE 2-55 2-56
4. DIAGRAMA DEL CIRCUITO MICOM
2007. 11. 30
A
1
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B C D E F G H I J K L M N O P Q R S T
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Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE2-57 2-58
5. DIAGRAMA DEL CIRCUITO E/S
2007. 11. 30
A
1
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B C D E F G H I J K L M N O P Q R S T
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Slo para uso interno de LGE 2-59 2-60
6. DIAGRAMA DEL CIRCUITO DE AMP
2007. 11. 30
A
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B C D E F G H I J K L M N O P Q R S T
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Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
Slo para uso interno de LGE2-61 2-62
7. DIAGRAMA DEL CIRCUITO MIC
2007. 11. 30
A
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B C D E F G H I J K L M N O P Q R S T
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Slo para uso interno de LGE 2-63 2-64
8. DIAGRAMA DEL CIRCUITO FRONTAL
2007. 11. 30
A
1
2
3
4
5
6
7
8
9
10
11
12
B C D E F G H I J K L M N O P Q R S T
-
2-65 2-66
9. DIAGRAMA DEL CIRCUITO TECLA
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Slo para uso interno de LGE
2007. 11. 30
A
1
2
3
4
5
6
7
8
9
10
11
12
B C D E F G H I J K L M N O P Q R S T
-
2-67 2-68
10. DIAGRAMA DEL CIRCUITO MIC, USB Y PTB
2007. 11. 30
A
1
2
3
4
5
6
7
8
9
10
11
12
B C D E F G H I J K L M N O P Q R S T
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-
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DIAGRAMAS DE PLACA DE CIRCUITO IMPRESO1. DIAGRAMA DE PLACA P.C. PRINCIPAL (VISTA SUPERIOR)
-
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DIAGRAMA DE PLACA P.C. PRINCIPAL (VISTA INFERIOR)
-
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2. DIAGRAMA DE PLACA P.C. SMPS
NOTAS) Advertencia Las piezas que estnoscurecidas son crticas con respectoal riesgo de producirse un incendio ouna descarga elctrica.
-
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DIAGRAMA DE PLACA P.C. TEMPORIZADOR (HT353)
2-75 2-76
3. DIAGRAMA DE PLACA P.C. TEMPORIZADOR (HT303)
4. DIAGRAMA DE PLACA P.C. TECLA (HT303) DIAGRAMA DE PLACA P.C. TECLA (HT353)
5. DIAGRAMA DE PLACA P.C. FRONTAL JACK
-
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SECCIN DEL ARMARIO Y ESTRUCTURA PRINCIPAL
275
A
B
C
E
CD
E
AB
279
A50
A43
CABLE1PN302
283
A26
463
A47
A41
463463
A46
275
467
D
262
261
260 261
A44
462
250
462
465
NOTES) THE EXCLAMATION POINT WITHIN AN EQUILATERAL TRIANGLE IS INTENDED TO ALERT THE SERVICE PERSONNEL TO THE PRESENCE OF IMPORTANT SAFETY INFORMATION IN SERVICELITERATURE.
FRONT JACK
SMPS
MAIN
PN202
465
SECCIN 3. VISTAS AMPLIADAS
463
300
-
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VISTA AMPLIADA DEL MECANISMO DE LA PLETINA(DP-12TV)
012
010
012
012A
019 442
442
A26
A02 A01
A03
001
002
003439018
013
017
014020
016
440
015
015B
015A
435
026
037
NSP : Non SVC Parts
LOCA. NO. LG PART NO. DESCRIPTION SPECIFICATION REMARKSA26 AFP67993502 Mechanism Assembly HOME THEATER DP-12TV-1 DVD (HZ NSP
A01 ACA34280801 Clamp Assembly DECK/MECHA DP-12/13 ferrite ty
A02 3041R-T010Q Base Assembly DP-12T-1 LOADING
A03 3041R-T011L Base Assembly SLED DP-12TV (HZ)
001 MGJ38556601 Plate PRESS SECC 0.8 dp-13 PRESS upp NSP
002 RAB30611501 Magnet,Ferrite FERRITE 50G NSP
003 MBU38556801 Clamp MOLD POM DECK/MECHA dp-13 MOLD NSP
010 6850R-JW16B Cable,FFC 1.0-23-160-E-5x10x5x10-0.035x0
012 MCQ41263801 Damper MOLD BUTYL RUBBER DECK/MECHA D
012A MCQ38556901 Damper EXTRUSION BUTYL RUBBER DECK/ME
013 4400R-0006B Belt MOLD RUBBER DECK/MECHA DP2-5,
014 4470R-0154A Gear COMPLEX DVD DECK/MECHA DP8 PUL
015 4681R-A015D Motor Assembly,DC DVD DP-12A/T LOADING -
015A EAU43506801 Motor,DC JQ24-35H390 2V 90A 28A 0RPM 0R NSP
015A 4680R-E008A Motor,DC RF-300EA-1D390(80MM) 2V 90MA 2 ALTERNATE
015B 4560R-0008A Pulley MOLD POM DVD MD MOLD -
016 6871R-9297M PCB Assembly DP-12T-1 LOADING/FEEDING BACK
017 4470R-0176A Gear MOLD POM DVD DP-9 LOADING MO
018 4974R-0067A Guide MOLD POM DVD DP-9C UP/DOWN MOL
019 MDQ39573201 Frame MOLD ABS XR-401 UP/DOWN FRAME
020 MAM39573001 Base MOLD ABS XR-401 MAIN BASE MOLD
026 3390R-0033A Tray MOLD ABS DVD DP-9T(9T-SLIM) MO
037 EAZ40060202 Pick Up Assembly CMS-S77RFV(1) CMS-S77RFV(1) IM
435 1SZZR-0011A Screw,Customized MACHINE
439 1SZZR-0075A Screw,Customized - + 1.7MM 10MM SWRCH FZW SIN
440 1SZZH-1007B Screw,Customized + D2.0 6MM SWRCH16A/ZNBK 4MM 1
442 FAB30124101 Screw,Taptite 1szzr-0064 PWH + B 2.6MM 7MM S
-
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SECCIN DE ACCESORIOS DE EMBALAJE
PILAS808
INSTRUCCIONES DE MONTAJE801CONT REM900
811 CONJUNTO ENCHUFE 1 VA (AMARILLO)
BOLSA804
EMBALAJE803
CAJA802
EMBALAJE803
824 ANTENA DE CUADRO (AM)
825 ANTENA (FM)
-
853
852
850
851
A83A82A81A80 F.L SPK
WIRE84WIRE83WIRE82WIRE81WIRE80 F.L SPK
F.R SPK CENTER SPK R.L SPK R.R SPK
F.R SPK
R.L SPKCENTER SPK
R.R SPKA84
3-6 Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
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1. ALTAVOZ SATELITE/CENTRAL (SH33SD-S)
PARTE DE ALTAVOCES
-
2. SUBWOOFER PASIVO (SH33SD-W)
950
A90
951
953
956
954
952
955
WIRE90
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-
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SECCIN 4. MECANISMO (DP-12TV)
[CONTENIDO]UBICACIN DE LAS PIEZAS DEL MECANISMO DE LA PLETINA
VISTA SUPERIOR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2 VISTA SUPERIOR (SIN BANDEJA DE DISCO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2 VISTA INFERIOR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2
DESMONTAJE DEL MECANISMO DE LA PLETINA1. BASE PRINCIPAL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
1-1. DISCO DE MONTAJE DE LA ABRAZADERA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-31-1-1. ABRAZADERA DE LA PLACA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-31-1-2. ABRAZADERA MAGNTICA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-31-1-3. ABRAZADERA SUPERIOR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
2. BANDEJA DE DISCO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
3. SLED DEL CONJUNTO BASE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-43-1. ENGRANAJE DE ALIMENTACIN . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-43-2. ENGRANAJE MEDIO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-43-3. PARRILLA DEL ENGRANAJE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
4. CAUCHO POSTER . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-45. CONJUNTO ARMAZN ARRIBA/ABAJO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-56. CARGA DE LA CORREA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-57. POLEA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-58. CARGA DEL ENGRANAJE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-59. GUA ARRIBA/ABA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-510. CARGA DEL CONJUNTO PWB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-511. BASE PRINCIPAL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5
VISTA AMPLIADA1. VISTA AMPLIADA DEL MECANISMO DE LA PLETINA (DP-12TV) . . . . . . . . . . . . . . . 4-6
-
4-2 Copyright 2008 LG Electronics. Inc.Todos los derechos reservados.Slo con fines de capacitacin y mantenimiento
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UBICACIN DE LAS PIEZAS DEL MECANISMO DE LA PLETINAN inicio
1
1, 2
1, 2, 3
1, 2, 3, 4
1
1, 6
1, 2, 6
1, 2, 6, 8
1, 2, 6, 8,
9
1, 2, 7
1, 2, 7
1, 2
1, 2 ,13
1, 2, 13, 14
1, 2, 7, 12, 13,
14
1, 2, 13
1, 2, 7, 12, 13,
14, 15, 16, 17
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
Base principal
Disco de montaje dela abrazadera
Abrazadera de la placa
Abrazadera magnticaBrida superior
Bandeja de discoSled del conjunto base
Engranaje dealimentacin
Engranaje medio
Parrilla del engranaje
Caucho posteriorConjunto armaznarriba/abajoCarga correaPolea
Carga del engranajeGua arriba/abajoCarga conjuntoPWB
Base principal
4 tornillo
1 conector
1 pestaas de bloqueo
1 tornillo
1 tornillo
1 pestaa de bloqueo
1 pestaa de bloqueo
1 pestaa de bloqueo
1 gancho 2 tornillo2 pestaas de bloqueo
4-1
4-1
4-1
4-1
4-1
4-2
4-3
4-3
4-3
4-3
4-3
4-4
4-4
4-4
4-4
4-4
4-4
4-4
Bottom
Bottom
ProcedimientoPiezas Tipo de fijacin Fig-
uraDesmon
- taje
NoteAl volver a montar, realice el procedimiento peroen orden contrario.La "parte inferior" en la columna del desmontajede la tabla anterior indica la pieza que deberadesmontarse en el lado inferior.
VISTA SUPERIOR (SIN BANDEJA DE DISCO)
VISTA INFERIOR
VISTA SUPERIOR
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DESMONTAJE DEL MECANISMO DE LA PLETINA
1. BASE PRINCIPAL (FIG. 4-1)1-1. Disco de montaje de la abrazadera1) Coloque el disco de montaje de la abrazadera
como indica la Fig. (A)2) Levante el disco de montaje de la abrazadera en
la direccin que indica la flecha (A).3) Separe el disco de montaje de la abrazadera de
la portaabrazadera.1-1-1. Abrazadera de la placa1) Gire la abrazadera de la placa en sentido
contrario a las agujas del reloj y, a continuacin,levante la abrazadera de la placa.
1-1-2. Abrazadera magntica1-1-3. Brida superior
2. BANDEJA DE DISCO (FIG. 4-2)1) Inserte e introduzca hacia el interior un
accionador en el orificio de expulsin deemergencia (A) del lado derecho o introdzcaloen la palanca (B) del engranaje de emergenciatire de la palanca (B) en la direccin que indicala flecha para poder expulsar la bandeja deldisco unos 15 o 20mm.
2) Tire del disco de la bandeja hasta separarlo dela base principal completamente.
BASE PRINCIPALBANDEJA DEDISCOS
BASE PRINCIPAL
NIVELADOR
BASE PRINCIPAL
BOTTOM SIDE VIEW
ABRAZADERA DELA PLACAABRAZADERAMAGNTICABRIDA SUPERIOR
SOPORTE
BASE PRINCIPAL
Fig. 4-2Fig. 4-1
(Fig. A)
MONTAJE DE LABRIDA DEL DISCO
-
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3. SLED DEL CONJUNTO BASE (FIG. 4-3)1) Quite 4 tornillos (S2).2) Desconecte el conector FFC (C1)
3-1. Engranaje de alimentacin3-2. Engranaje medio
3-3. Parrilla del engranaje1) Quite el tornillo (S3)
4. CAUCHO POSTERIOR (FIG. 4-3)
BASE PU
AMORTIGUADORDE CAUCHO
AMORTIGUADOR DE CAUCHO
AMORTIGUADORDE CAUCHODistingue las partessuperiores e inferiores(montar con cuidado)
Distingue las partes superiores einferiores (montar con cuidado)
AMORTIGUADORDE CAUCHO
TOMA GEAR
CONJUNTO GENERAL DE LECTURA
CONJUNTO DEL HUSILLO DEL MOTOR
Fig. 4-3
(S2)(S2)
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5. CONJUNTO DEL ARMAZNARRIBA/ABAJO (FIG 4-4))
NotePonga la cara de la base principal hacia abajo (Ladoinferior)1) Saque el tornillo (S4).2) Desbloquee la pestaa de bloqueo (L3) en la
direccin que indica la flecha y, a continuacin,levante el conjunto del armazn arriba/abajopara separarlo de la base principal.
Note Al volver a montar, mueva la gua arriba/abajo en
la direccin que indica la flecha (C) hasta quequede posicionada como en la Fig.(C).
Al volver a montar, inserte la porcin (A) delconjunto del armazn arriba/abajo en la porcin(B) de la gua arriba/abajo como indica la Fig.(B)
6. CARGA DE LA CORREA (FIG 4-4)NotePonga la base principal en la posicin original (Ladosuperior)
7. POLEA (FIG. 4-4)1) Desbloquee la pestaa de bloqueo (L4) en la
direccin que indica la flecha (B) y, a continuacin,separe la polea de la base principal.
8. CARGA DEL ENGRANAJE (FIG 4-4)9. GUA ARRIBA/ABAJO (FIG. 4-4)
1) Mueva la gua arriba/abajo en la direccin que indicala flecha (A) como indica la Fig.(A)
2) Tire hacia bajo de la pestaa de bloqueo (L5) y, acontinuacin, levante la gua arriba/abajo parasepararla de la base principal.
NoteCuando vuelva a montar, coloque la gua arriba/abajocomo se indica en la Fig. C y muvala en la direccin de laflecha (B) hasta que quede bloqueada por la pestaa debloqueo (L5). Confirme que la gua arriba/abajo queda enposicin como puede apreciar en la Fig.(A))
10. CARGA DEL CONJUNTO PWB (FIG. 4-4)NotePonga la cara de la base principal hacia abajo(lado inferior)1) Quite 1 tornillo (S5)2) Desbloquee el motor de carga (C2) del gancho (H1)
de la base principal.3) Desbloquee las 2 pestaas de bloqueo (L6) y
seprelas del conjunto de carga PWB desde la baseprincipal.
11. BASE PRINCIPAL (FIG. 4-4)
CARGA DEL ENGRANAJE
POLEA
CARGA DE LA CORREA
CONJUNTO PWB CARGANDO
BASEPRINCIPAL
GUA ARRIBA/ABAJO
GUA ARRIBA/ABAJO
GUA ARRIBA/ABAJO
MONTAJE DEL ARMAZNARRIBA/ABAJO
GUA ARRIBA/ABAJO
BASEPRINCIPAL
(L6)
(L4)
(L6)
(H1)(C2)
(S5)(S4)
(S4)
(A)
(A)
(B)
(B)(C)
(L5)FIG. (A)
FIG. (B)
FIG. (C)
(A)
(B)
Fig. 4-4
INSERCIN DE TORNILLOPARA EL CONTROL DETORSIN (800gf ABAJO)
-
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